RISC

出典: くみこみックス

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　１．縮小命令セット・コンピュータの略です．マイクロプロセッサのアーキテクチャの一つです．制御命令を減らし，加減算などの単純な処理の組み合わせで回路を単純化し演算速度の向上を図る手法です．ARMプロセッサは32ビットRISC CPUです．
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　縮小命令セット・コンピュータの略です．マイクロプロセッサのアーキテクチャの一つです．制御命令を減らし，加減算などの単純な処理の組み合わせで回路を単純化し演算速度の向上を図る手法です．ARMプロセッサは32ビットRISC CPUです．
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【出典】Interface編集部 編；組み込み技術用語集，Interface 2007年8月号 別冊付録，CQ出版社，2007年8月．
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【出典】宮崎 仁；ARM用語集，デザイン ウェーブ マガジン 2008年6月号 別冊付録，CQ出版社，2008年6月．
<!-- 【著作権者】宮崎 仁氏 -->
<!-- 【著作権者】宮崎 仁氏 -->
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　CPUのアーキテクチャの一つにRISCがあります．RISCの特徴は，命令の簡素化を行うことで命令長を固定（固定長命令）し，これにより命令をパイプライン処理しやすくしたことにあります．パイプライン処理により命令の並列処理と高クロック化が期待でき，CPUの処理能力を高めることが期待できます．ただし，命令の簡素化を行った結果，CISCタイプのCPUでは1命令で実行できた処理も，RISCでは複数の命令で処理することになります．
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　２．CPUのアーキテクチャの一つにRISCがあります．RISCの特徴は，命令の簡素化を行うことで命令長を固定（固定長命令）し，これにより命令をパイプライン処理しやすくしたことにあります．パイプライン処理により命令の並列処理と高クロック化が期待でき，CPUの処理能力を高めることが期待できます．ただし，命令の簡素化を行った結果，CISCタイプのCPUでは1命令で実行できた処理も，RISCでは複数の命令で処理することになります．
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2009年2月20日 (金) 07:07の版

RISC（Reduced Instruction Set Computer）

　縮小命令セット・コンピュータの略です．マイクロプロセッサのアーキテクチャの一つです．制御命令を減らし，加減算などの単純な処理の組み合わせで回路を単純化し演算速度の向上を図る手法です．ARMプロセッサは32ビットRISC CPUです．

【出典】宮崎 仁；ARM用語集，デザイン ウェーブ マガジン 2008年6月号 別冊付録，CQ出版社，2008年6月．

　CPUのアーキテクチャの一つにRISCがあります．RISCの特徴は，命令の簡素化を行うことで命令長を固定（固定長命令）し，これにより命令をパイプライン処理しやすくしたことにあります．パイプライン処理により命令の並列処理と高クロック化が期待でき，CPUの処理能力を高めることが期待できます．ただし，命令の簡素化を行った結果，CISCタイプのCPUでは1命令で実行できた処理も，RISCでは複数の命令で処理することになります．

【出典】（株）アルティマ 技術統括部 一同，下馬場 朋禄，山際 伸一，横溝 憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号 別冊付録，CQ出版社，2008年12月．

"http://mix.kumikomi.net/index.php/RISC" より作成
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