3ステート・バッファ
出典: くみこみックス
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制御入力つきのバッファ（インバータ）回路．制御信号によって出力レベルが‘1’，‘0’，‘Z（ハイ・インピーダンス）’の3状態をとることができる．バス接続の出力段やI/O端子などに用いる． | 制御入力つきのバッファ（インバータ）回路．制御信号によって出力レベルが‘1’，‘0’，‘Z（ハイ・インピーダンス）’の3状態をとることができる．バス接続の出力段やI/O端子などに用いる． | ||
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【出典】西久保 靖彦；基本システムLSI用語辞典，CQ出版社，2000年5月． | 【出典】西久保 靖彦；基本システムLSI用語辞典，CQ出版社，2000年5月． | ||
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最新版
3ステート・バッファ（Three State Buffer）
制御入力つきのバッファ（インバータ）回路．制御信号によって出力レベルが‘1’，‘0’，‘Z（ハイ・インピーダンス）’の3状態をとることができる．バス接続の出力段やI/O端子などに用いる．
図 3ステート・バッファ
【出典】西久保 靖彦；基本システムLSI用語辞典，CQ出版社，2000年5月．
