配線遅延 - 変更履歴

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Worker — Mon, 16 Mar 2009 05:43:08 GMT

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	* [[配線容量]]		* [[配線容量]]

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	【出典】（株）アルティマ技術統括部一同，下馬場朋禄，山際伸一，横溝憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号別冊付録，CQ出版社，2008年12月．		【出典】（株）アルティマ技術統括部一同，下馬場朋禄，山際伸一，横溝憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号別冊付録，CQ出版社，2008年12月．
	<!-- 【著作権者】○○ ○○氏 -->		<!-- 【著作権者】○○ ○○氏 -->
		+	----
		+	LSI上の配線の引き回しによる信号遅延．従来は配線抵抗と配線容量を考慮するだけでよかったが，今後は配線インダクタンスも考慮する必要がある．
	<br>		<br>
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		+	【出典】西久保靖彦；基本システムLSI用語辞典，CQ出版社，2000年5月．
		+	<!-- 【著作権者】西久保靖彦氏 -->
		+	<br>
		+	<br>
		+	== 関連項目 ==
		+	* [[遅延時間]]
		+	* [[配線抵抗]]
		+	* [[配線容量]]

-	[[Category:組み込み技術全般\|ハイセンチエン]] [[Category:FPGA\|ハイセンチエン]]	+	[[Category:組み込み技術全般\|ハイセンチエン]] [[Category:FPGA\|ハイセンチエン]] [[Category:LSI]]

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Worker — Thu, 29 Jan 2009 02:32:34 GMT

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-	[[Category:組み込み技術全般]] [[Category:FPGA]]	+	[[Category:組み込み技術全般\|ハイセンチエン]] [[Category:FPGA\|ハイセンチエン]]

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配線遅延（はいせんちえん）【Wire Delay】

　配線自身が持つ抵抗・容量や，隣接する配線との間の容量などによって生じる遅延です．配線遅延は，LSIの製造プロセスや温度条件などによって異なります．またFPGAの場合，内部の回路規模が大きくなればなるほど配線遅延は大きくなります．この問題に対処するため，FPGAは，グローバル配線を用意したり，論理リソースの構造を工夫しています．
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【出典】（株）アルティマ技術統括部一同，下馬場朋禄，山際伸一，横溝憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号別冊付録，CQ出版社，2008年12月．

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[[Category:組み込み技術全般]] [[Category:FPGA]]

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