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出典: くみこみックス

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パリティ・ビット 【Parity Bit】 　エラー検出のため，データ内の1の個数が常に偶数または常に奇数になるように追加するビットです．送信元でパリティ・ビットを付加して，受信側でデータの1の個数を確認してデータの誤りをチェックします． <br> <br> 【出典】（株）アルティマ 技術統括部 一同，下馬場 朋禄，山際 伸一，横溝 憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号 別冊付録，CQ出版社，2008年12月． <!-- 【著作権者】○○ ○○氏 --> <br> <br> [[Category:組み込み技術全般|ハリティヒット]] [[Category:FPGA|ハリティヒット]]

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