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クロック・エッジ 【Clock Edge】

　クロック信号が“L”レベルから“H”レベル（もしくは“H”レベルから“L”レベル）へ遷移する部分をクロック・エッジといいます（'''図'''）．クロックの立ち上がりエッジとは，“L”レベルから“H”レベルへ遷移する部分，クロックの立ち下がりエッジは“H”レベルから“L”レベルへ遷移する部分のことです．同期式ディジタル回路で使用されるフリップフロップでは，クロックの立ち上がりエッジ時のデータが記録されます．また，DDRメモリなどはクロックの立ち上がりエッジと立ち下がりエッジの両方使ってメモリ・アクセスを行います．
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[[画像:fpga_f23.gif]]<br>
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'''図　クロック・エッジ'''
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【出典】（株）アルティマ 技術統括部 一同，下馬場 朋禄，山際 伸一，横溝 憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号 別冊付録，CQ出版社，2008年12月．
<!-- 【著作権者】○○ ○○氏 -->

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