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出典: くみこみックス

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LAB 【Logic Array Block】 　複数のLEまたはALMで構成される，Altera社のFPGAの論理ブロックの名称です．LAB内のLEまたはALMの数はデバイスによって異なります．LABはLE/ALMのほか，キャリ・チェーン，共有演算チェーン，LABコントール信号，ローカル・インターコネクト，レジスタ・チェーンなどを備えています（'''図'''）．このような論理ブロック構造をとることにより，効率的に資源を利用し，性能を向上できます． <br> <br> 【出典】（株）アルティマ 技術統括部 一同，下馬場 朋禄，山際 伸一，横溝 憲治；システム開発者のためのFPGA用語集，Design Wave Magazine 2008年12月号 別冊付録，CQ出版社，2008年12月． <!-- 【著作権者】○○ ○○氏 --> <br> <br> <br> <center> [[画像:fpga_f8.gif]]<br> <br> '''図　LABの構成''' </center> == 関連項目 == * [[論理ブロック]] [[Category:組み込み技術全般]] [[Category:FPGA]]

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